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IP SoC China 26 2026年9月10日

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• 基于 TSMC 180BCD Gen3 工艺的车规级eFlash IP核
• 满足 AEC-Q100 Grade 1 严苛要求,具备 <20ms 极速擦除能力
• 无需更改 PDK,内置电荷泵与 ECC

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• 支持 Gen6 (PAM4) 并向下兼容 Gen5
• 低功耗、低延迟架构
• 支持先进制程 (≤7nm)
• 控制器 + PHY 一体化集成解决方案 • 热推 IP核:MIPI A-PHY, DDR5/LPDDR5


Pulsar™ D440: 支持 AV2 格式的实时多标准解码器 IP核
Sirius™ AV2: 专为编解码器验证打造的兼容性测试套件
Astralis™ AV2: 用于深度 AV2 码流分析的高级码流分析仪

更多最新研发动态
请查阅Pulsar D440 AV2 解码器 IP 官方新闻稿。

为每一颗芯粒锚定 硬件信任根

• 每颗芯粒都需要独立的硬件信任根
• PUFrt:OTP、PUF、TRNG 三合一硅基硬件信任根 IP
• 补齐 Caliptra 缺失的物理信任根
• 先进制程验证,已量产至 3nm

观看我们的EE Times芯粒安全演讲,6 月 25 日,02:05 CST >>